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↓在 博客日志 中搜索到 1278 條關(guān)于“ASIC”的信息，用時:0.004 sec.

一種新型音頻功放數(shù)字電調(diào)諧的ASIC實現(xiàn)

音頻功放電路在實際應用中都要涉及到音量的電調(diào)諧問題,而通過調(diào)節(jié)放大電路的增益來控制音頻放大電路的音量是比較有效的,目前應用比較多的有以下2 種實現(xiàn)方法: 1)模擬控制方法,這種方法一般是在面板上放置電阻器,通過手動調(diào)節(jié)其大小來改變放大器增益. 這種方法的缺點是接觸表面易磨損,導致接觸不良,帶來...
2012-05-02

基于FPGA的原型：為什么所有的ASIC都應該采用FPGA來創(chuàng)建原型(下)

創(chuàng)建實速運行在系統(tǒng)環(huán)境中的ASIC設(shè)計原型的必要性正日益增大。實現(xiàn)這種性能級的最具成本效益的技術(shù)是建立一個基于FPGA的原型，目前ASIC設(shè)計的1/3是用這樣的原型進行驗證的，其中2/3可以采用單FPGA原型，另外1/3需要多FPGA實現(xiàn)。多FPGA原型創(chuàng)建較大規(guī)模ASIC設(shè)計的硬件原型可能需要多個FPGA器件，這種多芯...
2012-04-30

基于FPGA的原型：為什么所有的ASIC都應該采用FPGA來創(chuàng)建原型(上)

創(chuàng)建實速運行在系統(tǒng)環(huán)境中的ASIC設(shè)計原型的必要性正日益增大。實現(xiàn)這種性能級的最具成本效益的技術(shù)是建立一個基于FPGA的原型，目前ASIC設(shè)計的1/3是用這樣的原型進行驗證的，其中2/3可以采用單FPGA原型，另外1/3需要多FPGA實現(xiàn)。 ASIC設(shè)計的規(guī)模、復雜度和成本在不斷增加。(基于討論目的，假設(shè)ASIC...
2012-04-30

ASIC設(shè)計中驗證工具選擇實例

前言伴隨著工藝技術(shù)水平的提高，當前ASIC設(shè)計規(guī)模和設(shè)計復雜度也不斷的提高。合理的選擇驗證工具在ASIC設(shè)計過程中起了關(guān)鍵作用。下面就結(jié)合實際的項目開發(fā)，對比驗證工具的特點，幫助大家更好的認識驗證工具。　　SystemC 介紹　　SystemC是一個開發(fā)硬件的面向?qū)?..
2012-04-27

基于Astro工具的ASIC時序分析

摘要：在目前的ASIC設(shè)計中，時鐘信號的質(zhì)量對同步數(shù)字電路的影響越來越大。如何避免時序問題給電路造成的不利影響成為設(shè)計中的重要挑戰(zhàn)。本文主要介紹了邏輯設(shè)計中值得注意的重要時序問題，以及如何克服這些問題。最后介紹了利用Astro工具進行時序分析的方法。關(guān)鍵詞：ASIC；同步數(shù)字電路；時序；Astro...
2012-04-26

如何在基于單元的ASIC和結(jié)構(gòu)化ASIC之間進行抉擇？(下)

隨著90納米工藝技術(shù)的出現(xiàn)，ASIC設(shè)計者開始探索更高水平的性能和密度。然而，從串擾、噪聲到IR降和時序收斂等一系列富于挑戰(zhàn)性的設(shè)計完整性問題也隨之產(chǎn)生。而日益增多的硅集成方案使開發(fā)過程進一步復雜化，今天的設(shè)計者可以使用基于單元的或結(jié)構(gòu)化ASIC方法學來實現(xiàn)各種設(shè)計。開發(fā)成本在該小組的...
2012-04-26

如何在基于單元的ASIC和結(jié)構(gòu)化ASIC之間進行抉擇？(上)

隨著90納米工藝技術(shù)的出現(xiàn)，ASIC設(shè)計者開始探索更高水平的性能和密度。然而，從串擾、噪聲到IR降和時序收斂等一系列富于挑戰(zhàn)性的設(shè)計完整性問題也隨之產(chǎn)生。而日益增多的硅集成方案使開發(fā)過程進一步復雜化，今天的設(shè)計者可以使用基于單元的或結(jié)構(gòu)化ASIC方法學來實現(xiàn)各種設(shè)計。總體設(shè)計目標我們的...
2012-04-26

基于FPGA的原型：為什么所有的ASIC都應該采用FPGA來創(chuàng)建原型(下)

創(chuàng)建實速運行在系統(tǒng)環(huán)境中的ASIC設(shè)計原型的必要性正日益增大。實現(xiàn)這種性能級的最具成本效益的技術(shù)是建立一個基于FPGA的原型，目前ASIC設(shè)計的1/3是用這樣的原型進行驗證的，其中2/3可以采用單FPGA原型，另外1/3需要多FPGA實現(xiàn)。多FPGA原型創(chuàng)建較大規(guī)模ASIC設(shè)計的硬件原型可能需要多個FPGA器件，這種多芯...
2012-04-22

基于FPGA的原型：為什么所有的ASIC都應該采用FPGA來創(chuàng)建原型(上)

創(chuàng)建實速運行在系統(tǒng)環(huán)境中的ASIC設(shè)計原型的必要性正日益增大。實現(xiàn)這種性能級的最具成本效益的技術(shù)是建立一個基于FPGA的原型，目前ASIC設(shè)計的1/3是用這樣的原型進行驗證的，其中2/3可以采用單FPGA原型，另外1/3需要多FPGA實現(xiàn)。 ASIC設(shè)計的規(guī)模、復雜度和成本在不斷增加。(基于討論目的，假設(shè)ASIC...
2012-04-22

基于H.264的Exp-Golomb解碼器ASIC設(shè)計

ITU-T(國際電信聯(lián)盟)和MPEG(運動圖像專家組)聯(lián)合推出了新一代視頻壓縮標準H．264／MPEG一4-10 AVC。它在DCT變換、熵編碼、去塊濾波等方面采用了一系列新技術(shù)，在相同的重建圖像質(zhì)量下比H．263和MPEG-4節(jié)約了50％的碼率，在高碼率應用中表現(xiàn)更加優(yōu)越。同時，它具有良好的...
2012-04-19

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