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Altera Quartus II軟件v13.0支持實(shí)現(xiàn)快速FPGA設(shè)計(jì)

21ic訊 Altera公司日前宣布推出Quartus® II軟件13.0版，這一軟件實(shí)現(xiàn)了性能最好的FPGA和SoC，提高了設(shè)計(jì)人員的效能。28 nm FPGA和SoC用戶的編譯時(shí)間將平均縮短25%。與以前的軟件版本相比，該版本可以將面向高端28 nm Stratix® V FPGA的，最難收斂的設(shè)計(jì)編譯時(shí)間平均縮短50%。Quartus II軟件v...
2013-05-07

DSP TSMP FPGA 多路交流異步采樣

本文介紹了一種在DSP平臺(tái)下對(duì)多路交流信號(hào)采樣時(shí)采用的一種異步采樣方法。在對(duì)電力線路的電壓和電流進(jìn)行測(cè)量時(shí)，為使測(cè)量值具有較高的精度，一般都采用交流采樣技術(shù)。目前，比較常用的交流采樣方法是：在交流信號(hào)的一個(gè)周期內(nèi)，等間隔采樣N點(diǎn)數(shù)據(jù)，然后利用傅立葉變換，計(jì)算出基波及一些諧波的有效值，...
2013-04-29

基于FPGA協(xié)處理器的算法加速的實(shí)現(xiàn)

當(dāng)今的設(shè)計(jì)工程師受到面積、功率和成本的約束，不能采用GHz級(jí)的計(jì)算機(jī)實(shí)現(xiàn)嵌入式設(shè)計(jì)。在嵌入式系統(tǒng)中，通常是由相對(duì)數(shù)量較少的算法決定最大的運(yùn)算需求。使用設(shè)計(jì)自動(dòng)化工具可以將這些算法快速轉(zhuǎn)換到硬件協(xié)處理器中。然后，協(xié)處理器可以有效地連接到處理器，產(chǎn)生“GHz”級(jí)的性能。本文主要研究了代碼加...
2013-04-28

盡己之事賽靈思明確FPGA未來(lái)市場(chǎng)定位

與28nm的追逐戰(zhàn)不同，當(dāng)Altera一邊廂大力推進(jìn)其基于下一代工藝的產(chǎn)品系列時(shí)，賽靈思并沒(méi)有馬上跟進(jìn)或很激進(jìn)的開始火拼之勢(shì)，而是淡定的盡己之事，為自己的FPGA產(chǎn)品做很好的未來(lái)市場(chǎng)定位，打造一種理念。我們知道賽靈思在努力向智能的系統(tǒng)解決方案提供商轉(zhuǎn)型，近期推出的Smarter Network 和 Smarter Vis...
2013-04-17

設(shè)計(jì)FPGA系統(tǒng)應(yīng)了解的三個(gè)原則

一.面積與速度的平衡互換原則這里的面積指的是FPGA的芯片資源，包括邏輯資源和I/O資源等;這里的速度指的是FPGA工作的最高頻率(和DSP或者ARM不同，F(xiàn)PGA設(shè)計(jì)的工作頻率是不固定的，而是和設(shè)計(jì)本身的延遲緊密相連)。在實(shí)際設(shè)計(jì)中，使用最小的面積設(shè)計(jì)出最高的速度是每一個(gè)開發(fā)者追求的目標(biāo)，但是“魚和熊...
2013-04-15

FPGA工程師：如何在FPGA中實(shí)現(xiàn)狀態(tài)機(jī)？

FPGA常常用于執(zhí)行基于序列和控制的行動(dòng)，比如實(shí)現(xiàn)一個(gè)簡(jiǎn)單的通信協(xié)議。對(duì)于設(shè)計(jì)人員來(lái)說(shuō)，滿足這些行動(dòng)和序列要求的最佳方法則是使用狀態(tài)機(jī)。狀態(tài)機(jī)是在數(shù)量有限的狀態(tài)之間進(jìn)行轉(zhuǎn)換的邏輯結(jié)構(gòu)。一個(gè)狀態(tài)機(jī)在某個(gè)特定的時(shí)間點(diǎn)只處于一種狀態(tài)。但在一系列觸發(fā)器的觸發(fā)下，將在不同狀態(tài)間進(jìn)行轉(zhuǎn)換。　　理...
2013-04-02

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