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↓在 博客日志 中搜索到 908 條關于“Altera”的信息，用時:0.003 sec.

基于SRAM工藝CPLD/FPGA的可重配置電路

基于SRAM的可重配置PLD（可編程邏輯器件）的出現，為系統設計者動態改變運行電路中PLD的邏輯功能創造了條件。PLD使用SRAM單元來保存字的配置數據決定了PLD內部互連和功能，改變這些數據，也就改變了器件的邏輯功能。由于SRAM的數據是易失的，因此這些數據必須保存在PLD器件以外的EPROM，EEPROM或FLASH ...
2012-04-05

片上系統（SOC）設計與EDA

摘要：利用EDA工具和硬件描述語言（HDL），根據產品的特定要求設計性能價格比高的片上系統，是目前國際上廣泛使用的方法。與傳統的設計方法不同，在設計開始階段并不一定需要具體的單片微控制器（MCU）和開發系統(仿真器)以及帶有外圍電路的線路板來進行調試，所需要的只是由集成電路制造廠家提供的用H...
2012-04-05

用SignalTap嵌入邏輯分析儀驗證PLD設計

要說ASIC設計者的經驗有所提示的話，那么將來的百萬門級可編程邏輯設計中驗證會耗費大半的設計周期。隨著設計復雜度的增加，傳統的設計驗證方法如仿真需要其它技術和工具的補充，因為這些可編程芯片系統（SOPC）進行完全的真實模擬是不可在適當的時間內完成。而且，設計規模的陡增必然需要新的工具來觀...
2012-04-05

基于NIOS嵌入式軟核的硬盤錄像機的設計與實現

隨著現場可編程邏輯陣列( FPGA) 技術的日益成熟,基于片上的可編程( SOPC)的嵌入式處理器受到越來越多的關注。特別是Altera公司推出的NIOS嵌入式處理器軟核, 通過軟件編程的方法可靈活地實現嵌入式處理器的功能, 并且針對FPGA進行性能優化, 可以大大提高系統性能。此外，NIOS還具有片上調試功能,因此便于...
2012-04-05

基于Nios II系統1553B總線網絡存儲器設計

20世紀70年代誕生的1553B總線，是一種主從式多余度總線，對總線硬件有嚴格的規定，可靠性和實時性好，已經成為當今軍用電子總線的首選。類似于以太網，1553B組網中也有“網絡硬盤”這樣的存儲需求，來減輕本地的存儲壓力，并可作為數據中繼供其他部分甚至其他組網使用。Nios II嵌入式處理器是Altera公司...
2012-04-05

基于NiosII的SOPC多處理器系統設計方法

摘要詳細地闡述基于NiosIl和FPGA的多處理器系統的實現機制，討論利用硬件互斥核實現多處理器資源共享的方法，并給出硬件設計的具體步驟以及軟件設計、調試方法和關鍵技術；利用Altera公司提供的QuartusII、SOPC Builder和NiosII IDE等開發工具，通過一個3處理器系統設計實例，驗證了設計方法的正...
2012-04-05

在NIOS II系統中A/D數據采集接口的設計與實現

在FPGA系統中，實現對外部A/D數據采集電路的控制接口邏輯，由于其邏輯功能不是很復雜，因此可采用自定義的方式。采用這種方法進行設計有兩種途徑。①從軟件上去實現。這種方案將NIOS處理器作為一個主控制器，通過編寫程序來控制數據轉換電路。由于NIOS處理器的工作頻率相對于外部設備來說要高出許多，故...
2012-04-05

基于NiosII的視頻采集與傳輸系統

1 引言采用軟件編程實現傳統圖像的采集和處理，這需要占用大量的CPU資源，一方面CPU要提高系統工作頻率，使得整個系統的可靠性接受很大的挑戰，另一方面這類系統難以處理實時、高分辨率的圖像。采用NiosII加上FPGA可解決這些問題。Altera公司推出的NiosII是一種可配置的RISC嵌入式軟核處理器，它可與各...
2012-04-05

基于Nios II和eCos的串口通信程序開發

嵌入式開發人員必須選擇一款處理器，以此決定合適的系統性能。Nios II處理器使用指令和數據存儲器分離的存儲器結構，具有靈活的結構可修改性，支持自定制指令。Nios II處理器支持片上調試，通過JTAG調試通道，可以實現指令單步、斷點、連續運行等調試功能。使用系統開發工具將處理器、外設、存儲器和I/...
2012-04-05

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