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↓在 博客日志 中搜索到 3066 條關于“FPGA”的信息，用時:0.005 sec.

關于FPGA時鐘的討論（2）

3．多級邏輯時鐘當產生門控時鐘的組合邏輯超過一級(即超過單個的“與”門或“或”門)時，證設計項目的可靠性變得很困難。即使樣機或仿真結果沒有顯示出靜態險象，但實際上仍然可能存在著危險。通常，我們不應該用多級組合邏輯去鐘控PLD設計中的觸發器。圖7 給出一個含有險象的多級時鐘的例子。時...
2012-04-15

關于FPGA時鐘的討論（1）

無淪是用離散邏輯、可編程邏輯，還是用全定制硅器件實現的任何數字設計，為了成功地操作，可靠的時鐘是非常關鍵的。設計不良的時鐘在極限的溫度、電壓或制造工藝的偏差情況下將導致錯誤的行為，并且調試困難、花銷很大。在設計PLD/FPGA時通常采用幾種時鐘類型。時鐘可分為如下四種類型：全局時鐘、門控...
2012-04-15

高速FPGA系統的信號完整性測試和分析

1. 引言隨著FPGA的設計速度和容量的明顯增長，當前流行的FPGA芯片都提供高速總線，例如DDR內存總線，PCI-X總線、SPI總線；針對超高速的數據傳輸，FPGA通過集成SerDes提供高速串行IO，支持各種諸如PCI-E、GBE、XAUI等高速串行總線協議，為各種不同標準的高速傳輸提供極大的靈活性。典...
2012-04-14

使用一個FPGA便可實現的64通道下變頻器

RF Engines公司的ChannelCore64使設計者能夠用一個可對FPGA編程的IP核來替代多達16個DDC(直接下變頻器)ASIC，可顯著減少PCB面積，降低功耗而且增加靈活性。和原來的方法相比，新方法是降低成本的典型代表，隨著通道數目的增加，降低成本的需求愈加突出。在提供靈活性和簡化設計的同時，這種方法也能降低...
2012-04-12

基于FPGA的IDE硬盤接口卡的實現

引言　　本文采用FPGA實現了IDE硬盤接口協議。系統提供兩套符合ATA-6規范的IDE接口，一個與普通IDE硬盤連接，另一個與計算機主板上的IDE接口相連。系統采用FPGA實現接口協議，完成接口數據的截獲、處理（在本文中主要是數據加密）和轉發，支持PIO和Ultra DMA兩種數據傳輸模式。下面重點介紹用FPGA實現接...
2012-04-12

WCDMA速率適配算法的FPGA實現

摘要：為了支持多媒體業務的傳輸，第三代移動通信WCDMA系統采用了獨特的編碼復接方案，同時也加大了系統復雜度，并引入了較長的處理時延。速率適配算法是業務復用方案的核心算法。本文具體提出了在FPGA中進行模塊合并、產生鑿孔圖樣進行比特積攢搬移的實現方案，縮短了處理延時，大大提高了系統的處理...
2012-04-12

FPGA系統的仿真和測試

1 概述FPGA仿真方法：（1）交互式仿真方法：利用EDA工具的仿真器進行仿真，使用方便，但輸入輸出不便于記錄規檔，當輸入量較多時不便于觀察和比較。（2）測試平臺法：為設計模塊專門設計的仿真程序，可以實現對被...
2012-04-12

復用器重構降低FPGA成本

摘要本文介紹了一種新的能夠降低FPGA實際設計20％成本的綜合算法。該算法通過減少復用器所需查找表（LUT）的數量來實現。算法以效率更高的4:1復用器替代2:1復用器樹。算法性能關鍵在于尋找總線上出現的復用器數量。新的優化方法占用一定的邏輯，這些邏輯由總線進行分擔，從而減少了總線上每個比特位所需...
2012-04-11

采用編譯增強技術，提高高密度FPGA設計工作效率

現場可編程門陣列（FPGA）體系創新以及向90nm工藝技術的過渡顯著提高了FPGA的密度和性能。FPGA設計人員不僅需要更高的邏輯密度和更快的性能表現，還要求具有嵌入式處理器、數字信號處理（DSP）模塊以及其他硬件IP結構等復雜的器件功能。但是，由于FPGA設計規模越來越大、越來越復雜，為了能夠抓住稍縱即...
2012-04-11

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