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應(yīng)用開(kāi)發(fā)

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基于邏輯分析內(nèi)核的FPGA電路內(nèi)調(diào)試技術(shù)

隨著FPGA融入越來(lái)越多的能力，對(duì)有效調(diào)試工具的需求將變得至關(guān)重要。對(duì)內(nèi)部可視能力的事前周密計(jì)劃將能使研制組采用正確的調(diào)試戰(zhàn)略，以更快完成他們的設(shè)計(jì)任務(wù)?！　　拔抑牢业脑O(shè)計(jì)中存在一個(gè)問(wèn)題，但我沒(méi)有很快找到問(wèn)題所需要的內(nèi)部可視能力?！庇捎谌狈ψ銐虻膬?nèi)部可視能力，調(diào)試FPGA基系統(tǒng)可能會(huì)受...
2012-04-07

FPGA設(shè)計(jì)開(kāi)發(fā)中應(yīng)用仿真技術(shù)解決故障的方法

本文針對(duì)FPGA實(shí)際開(kāi)發(fā)過(guò)程中，出現(xiàn)故障后定位困難、反復(fù)修改代碼編譯時(shí)間過(guò)長(zhǎng)、上板后故障解決無(wú)法確認(rèn)的問(wèn)題，提出了一種采用仿真的方法來(lái)定位、解決故障并驗(yàn)證故障解決方案?？梢源蟠蟮墓?jié)約開(kāi)發(fā)時(shí)間，提高開(kāi)發(fā)效率?！　PGA近年來(lái)在越來(lái)越多的領(lǐng)域中應(yīng)用，很多大通信系統(tǒng)（如通信基站等）都用其做核...
2012-04-07

平臺(tái)效應(yīng)加速SoC FPGA設(shè)計(jì)趨勢(shì)成形

SoC FPGA為一個(gè)整合FPGA架構(gòu)、硬式核心CPU子系統(tǒng)以及其他硬式核心IP的半導(dǎo)體元件，可實(shí)現(xiàn)低延時(shí)頻寬互聯(lián)，并提高IP重用性；預(yù)估此類型元件在今后10年中將會(huì)得到廣泛應(yīng)用，為系統(tǒng)設(shè)計(jì)人員提供更多的選擇。整整合了現(xiàn)場(chǎng)可編程閘陣列(FPGA)架構(gòu)、硬式核心中央處理器(CPU)子系統(tǒng)以及其他硬式核心矽智...
2012-04-07

FPGA經(jīng)驗(yàn)總結(jié)

覺(jué)得寫(xiě)得比不錯(cuò)，就轉(zhuǎn)載過(guò)來(lái)了。　　時(shí)序是設(shè)計(jì)出來(lái)的　　我的boss有在華為及峻龍工作的背景，自然就給我們講了一些華為及altera做邏輯的一些東西，而我們的項(xiàng)目規(guī)范，也基本上是按華為的那一套去做。在工作這幾個(gè)月中，給我感觸最深的是華為的那句話：時(shí)序是設(shè)計(jì)出來(lái)的，不是仿出來(lái)的，更不是湊出來(lái)...
2012-04-07

基于C語(yǔ)言的設(shè)計(jì)方式:簡(jiǎn)化FPGA/協(xié)處理器混合平臺(tái)軟硬件協(xié)同設(shè)計(jì)

在最近幾年中日益流行在高性能嵌入式應(yīng)用中使用現(xiàn)場(chǎng)可編程門(mén)陣列（FPGA）。FPGA已經(jīng)被證明有能力處理各種不同的任務(wù)，從相對(duì)簡(jiǎn)單的控制功能到更加復(fù)雜的算法操作。雖然FPGA在某些功能上比ASIC硬件具有時(shí)間和成本上的優(yōu)勢(shì)，但在面向軟件應(yīng)用中的FPGA比傳統(tǒng)處理器和DSP的優(yōu)勢(shì)并沒(méi)有體現(xiàn)出來(lái)。這很大程度上...
2012-04-05

基于SRAM工藝CPLD/FPGA的可重配置電路

基于SRAM的可重配置PLD（可編程邏輯器件）的出現(xiàn)，為系統(tǒng)設(shè)計(jì)者動(dòng)態(tài)改變運(yùn)行電路中PLD的邏輯功能創(chuàng)造了條件。PLD使用SRAM單元來(lái)保存字的配置數(shù)據(jù)決定了PLD內(nèi)部互連和功能，改變這些數(shù)據(jù)，也就改變了器件的邏輯功能。由于SRAM的數(shù)據(jù)是易失的，因此這些數(shù)據(jù)必須保存在PLD器件以外的EPROM，EEPROM或FLASH ...
2012-04-05

低電壓PLD/FPGA的供電設(shè)計(jì)

由于半導(dǎo)體制造工藝的原因，低電壓器件的成本比傳統(tǒng)5V器件更低，性能更優(yōu)，加上多數(shù)器件的I/O腳可以兼容5v/3.3v TTL電平，可以直接使用在原有系統(tǒng)中，所以各大半導(dǎo)體公司都將3.3v,2.5v等低電壓集成電路作為推廣重點(diǎn)，如高端的DSP,PLD/FPGA產(chǎn)品已廣泛采用3.3v,2.5v甚至1.8v,1.5v供電。面對(duì)低電壓芯片的...
2012-04-05

基于SYSTEM C的FPGA設(shè)計(jì)方法

摘要：隨著VLSI的集成度越來(lái)越高，設(shè)計(jì)也越趨復(fù)雜。傳統(tǒng)的設(shè)計(jì)方法如原理圖輸入、HDL語(yǔ)言描述在進(jìn)行復(fù)雜系統(tǒng)設(shè)計(jì)時(shí)，設(shè)計(jì)效率往往比較低。特別是在算法由軟件轉(zhuǎn)化為硬件的環(huán)節(jié)上，傳統(tǒng)的設(shè)計(jì)方法的效率不是很高，設(shè)計(jì)者往往要耗費(fèi)大量的時(shí)間和精力手工進(jìn)行算法的轉(zhuǎn)化。為解決這些問(wèn)題，一種新的系統(tǒng)級(jí)...
2012-04-05

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