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應(yīng)用開發(fā)

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2012-03-22

Xilinx：FPGA向標(biāo)準(zhǔn)化虛擬SoC平臺演進(jìn)

“ 未來的FPGA，將會采用創(chuàng)新的迭堆式封裝（SIP），即在一個封裝里放多個裸片的技術(shù)，到那時，F(xiàn)PGA將成為一個標(biāo)準(zhǔn)的、虛擬的SoC平臺來應(yīng)用。”　　半導(dǎo)體行業(yè)最讓人稱道的是，能把沙子做成比金子還要貴的產(chǎn)品，并且這個故事一直延續(xù)到今天。這也激發(fā)了人們的創(chuàng)新意識，并不斷展示創(chuàng)新性思維將創(chuàng)新技術(shù)和...
2012-03-21

基于FPGA的QPSK信號源的設(shè)計與實(shí)現(xiàn)

前言調(diào)相脈沖信號可以獲得較大的壓縮比，它作為一種常用的脈沖壓縮信號，在現(xiàn)代雷達(dá)及通信系統(tǒng)中獲得了廣泛應(yīng)用。隨著近年來軟件無線電技術(shù)和電子技術(shù)的發(fā)展，DDS（直接數(shù)字頻率合成）用于實(shí)現(xiàn)信號產(chǎn)生的應(yīng)用越來越廣。DDS技術(shù)從相位的概念出發(fā)進(jìn)行頻率合成，它采用數(shù)字采樣存儲技術(shù)，可以產(chǎn)生點(diǎn)頻、線...
2012-03-21

Xilinx DCM的使用

目前，大型設(shè)計一般推薦使用同步時序電路。同步時序電路基于時鐘觸發(fā)沿設(shè)計，對時鐘的周期、占空比、延時和抖動提出了更高的要求。為了滿足同步時序設(shè)計的要求，一般在FPGA設(shè)計中采用全局時鐘資源驅(qū)動設(shè)計的主時鐘，以達(dá)到最低的時鐘抖動和延遲。FPGA全局時鐘資源一般使用全銅層工藝實(shí)現(xiàn)，并設(shè)計了專用...
2012-03-21

FPGA+DSP核心架構(gòu)的實(shí)時三維圖像信息處理

三維圖像信息處理一直是圖像視頻處理領(lǐng)域的熱點(diǎn)和難點(diǎn)，目前國內(nèi)外成熟的三維信息處理系統(tǒng)不多，已有的系統(tǒng)主要依賴高性能通用PC完成圖像采集、預(yù)處理、重建、構(gòu)型等囊括底層和高層的處理工作。三維圖像處理數(shù)據(jù)量特別大、運(yùn)算復(fù)雜，單純依靠通用PC很難達(dá)到實(shí)時性要求，不能滿足現(xiàn)行高速三維圖像處理應(yīng)...
2012-03-21

Xilinx Spartan-3A DSP FPGA視頻開發(fā)方案

Xilinx 公司的Extended Spartan®-3A 系列FPGA的系統(tǒng)門從50K到340萬,提供跟種密度和封裝形式,集成了DSP MAC,具有最低的系統(tǒng)總成本同時又增加了功能,非常適合各中批量大的應(yīng)用.而Xilinx的Spartan-3A DSP FPGA視頻入門套件非常適合于評估Xilinx FPGA在各種視頻和圖像的應(yīng)用.該入門套件包括Spartan...
2012-03-21

基于FPGA的片上系統(tǒng)的無線保密通信終端

引言　　利用軟件實(shí)施加密算法已經(jīng)成為實(shí)時安全通信系統(tǒng)的重要瓶頸。標(biāo)準(zhǔn)的商品化CPU和DSP無法跟上數(shù)據(jù)加密算法的計算速度要求。此外，CPU和DSP需要完成太多的其他任務(wù)。基于FPGA高度優(yōu)化的可編程的硬件安全性解決方案提供了并行處理能力，并且可以達(dá)到所要求的加密處理性能基準(zhǔn)[1].然而如果僅使用FPGA...
2012-03-21

Xilinx Virtex-5 FPGA ML501評估開發(fā)方案

Xilinx 公司的Virtex-5 FPGA是功能強(qiáng)大的FPGA,采用第二代ASMBL列架構(gòu),包含有LX, LXT, SXT, TXT和FXT五個平臺.每個平臺有不同的特性,以滿足不同的應(yīng)用如數(shù)據(jù)傳輸和處理,數(shù)字視頻,嵌入式微處理器,總線接口以及高速設(shè)計應(yīng)用.而ML501評估平臺采用 Virtex-5 XC5VLX50-1FFG676 FPGA為主要開發(fā)器件.本文介紹了...
2012-03-21

Xilinx FPGA的功耗優(yōu)化設(shè)計

對于FPGA來說，設(shè)計人員可以充分利用其可編程能力以及相關(guān)的工具來準(zhǔn)確估算功耗，然后再通過優(yōu)化技術(shù)來使FPGA設(shè)計以及相應(yīng)的PCB板在功率方面效率更高。靜態(tài)和動態(tài)功耗及其變化在90nm工藝時，電流泄漏問題對ASIC和FPGA都變得相當(dāng)嚴(yán)重。在65nm工藝下，這一問題更具挑戰(zhàn)性。為獲得更高的晶體管性能，必須降...
2012-03-21

雷達(dá)視頻積累算法在FPGA上的實(shí)現(xiàn)

由于雷達(dá)所處的環(huán)境的復(fù)雜性，除了地物、云雨、鳥群等干擾外，還可能來自臨近的雷達(dá)異步干擾、電臺干擾等。所有的干擾，經(jīng)過接收機(jī)進(jìn)入信號處理機(jī)，雖然經(jīng)過了中頻信號的處理，但還可能有殘余。因此，為了得到更好的檢測性能，在檢測前進(jìn)行一次視頻積累是非常必要的。雖然視頻積累的效果不如相參積累，...
2012-03-21

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