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應(yīng)用開(kāi)發(fā)

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FPGA設(shè)計(jì)中的編程技巧

在數(shù)字系統(tǒng)設(shè)計(jì)中, FPGA 設(shè)計(jì)已成為數(shù)字系統(tǒng)設(shè)計(jì)領(lǐng)域中的重要方式之一, 在電子、通信等領(lǐng)域得到了廣泛應(yīng)用。本文以V er ilog HDL 為例, 討論了在進(jìn)行FPGA 設(shè)計(jì)中編寫代碼的技巧。
2007-11-28

Fpga設(shè)計(jì)的四種思想

本文討論的四種常用 FPGA/CPLD設(shè)計(jì)思想與技巧：乒乓操作、串并轉(zhuǎn)換、流水線操作、數(shù)據(jù)接口同步化，都是 FPGA/CPLD邏輯設(shè)計(jì)的內(nèi)在規(guī)律的體現(xiàn)，合理地采用這些設(shè)計(jì)思想能在FPGA/CPLD設(shè)計(jì)工作種取得事半功倍的效果。
2007-10-23

Fpga設(shè)計(jì)的四種思想

本文討論的四種常用 FPGA/CPLD設(shè)計(jì)思想與技巧：乒乓操作、串并轉(zhuǎn)換、流水線操作、數(shù)據(jù)接口同步化，都是 FPGA/CPLD邏輯設(shè)計(jì)的內(nèi)在規(guī)律的體現(xiàn)，合理地采用這些設(shè)計(jì)思想能在FPGA/CPLD設(shè)計(jì)工作種取得事半功倍的效果。
2007-10-23

十分鐘學(xué)會(huì)Xilinx FPGA 設(shè)計(jì)

本文檔主要幫助大家熟悉利用ISE進(jìn)行Xilinx公司的FPGA代碼開(kāi)發(fā)的基本流程.主要是幫助初學(xué)者了解和初步掌握ISE的使用,不需要FPGA的開(kāi)發(fā)基礎(chǔ),所以對(duì)每個(gè)步驟并不進(jìn)行深入的討論
2007-10-17

fpga設(shè)計(jì)檢查清單_如何提高設(shè)計(jì)的速度和可靠性

本檢查清單向你揭示了如何提高你的FPGA設(shè)計(jì)的速度和可靠性.本檢查清單適用于Xilinx公司的Virtex系列FPGA.采用這些技巧應(yīng)該能改進(jìn)你的設(shè)計(jì)性能.本檢查清單應(yīng)該能版主所有的FPGA設(shè)計(jì)者更好的利用FPGA資源并避免常見(jiàn)的問(wèn)題.
2007-10-17

fpga設(shè)計(jì)檢查清單_如何提高設(shè)計(jì)的速度和可靠性

本檢查清單向你揭示了如何提高你的FPGA設(shè)計(jì)的速度和可靠性.本檢查清單適用于Xilinx公司的Virtex系列FPGA.采用這些技巧應(yīng)該能改進(jìn)你的設(shè)計(jì)性能.本檢查清單應(yīng)該能版主所有的FPGA設(shè)計(jì)者更好的利用FPGA資源并避免常見(jiàn)的問(wèn)題.
2007-10-17

FPGA Synthesis with the Synplify Pro Tool

FPGA Synthesis with the Synplify Pro Tool,Synplicity公司的文檔,英文版,介紹了Synplicity工具的使用情況
2007-10-17

FPGA express的使用

Advanced HDL Design _Training On Xilinx FPGA,xilinx臺(tái)灣的工程師文檔.介紹了FPGA express的使用
2007-10-17

用FPGA設(shè)計(jì)MP3個(gè)人數(shù)字播放

本文講述了如何用FPGA實(shí)現(xiàn)MP3系統(tǒng)
2007-09-17

用FPGA設(shè)計(jì)MP3個(gè)人數(shù)字播放

本文講述了如何用FPGA實(shí)現(xiàn)MP3系統(tǒng)
2007-09-17

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