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解鎖思爾芯Genesis芯神匠虛擬原型平臺：混合仿真與多元應(yīng)用實踐

1、虛擬原型：芯片設(shè)計領(lǐng)域的革新利器芯片設(shè)計公司長期面臨雙重挑戰(zhàn)：既要研發(fā)高性能芯片方案，又得縮短周期搶先推新。當(dāng)下，系統(tǒng)與軟件的復(fù)雜度與日俱增，傳統(tǒng)軟件開發(fā)方法在當(dāng)下復(fù)雜形勢中弊端漸顯，如介入時間靠后增加了開發(fā)周期，難滿足行業(yè)發(fā)展，革新勢在必行。“Shift Left”&mdas... （來源：技術(shù)文章頻道）

思爾芯Genesis仿真 2025-7-16 10:15

增加驗證覆蓋范圍并減少工作量？SmartDV完備的VIP助您實現(xiàn)又快又好的芯片設(shè)計！

隨著現(xiàn)代芯片的復(fù)雜性不斷提高，驗證成為芯片設(shè)計過程中最耗時和費力的部分，許多芯片設(shè)計項目通常要耗費大約60%-80%的項目資源用于驗證，并且還成為了整個設(shè)計過程中的瓶頸，能否順利完成驗證成為了決定芯片上市時間（TTM）和項目整體成本的關(guān)鍵。正是因為這樣的復(fù)雜性和重要性，采用驗證IP（VIP）等工... （來源：新聞頻道）

SmartDV芯片設(shè)計仿真系統(tǒng) 2025-3-20 10:42

IP Your Way——您提供規(guī)格，然后SmartDV為您生成定制IP

快速、可靠且高性價比的定制IP模式提升芯片設(shè)計公司競爭力作者：Karthik GopalSmartDV Technologies亞洲區(qū)總經(jīng)理智權(quán)半導(dǎo)體科技（廈門）有限公司總經(jīng)理無論是在出貨量巨大的消費電子市場，還是針對特定應(yīng)用的細(xì)分芯片市場，差異化芯片設(shè)計帶來的定制化需求也在芯片設(shè)計行業(yè)中不斷凸顯，同時也成為了芯片... （來源：技術(shù)文章頻道）

IP Your Way SmartDV 2024-12-9 10:45

實際案例說明用基于FPGA的原型來測試、驗證和確認(rèn)IP——如何做到魚與熊掌兼得？

作者：Philipp Jacobsohn，SmartDV首席應(yīng)用工程師Sunil Kumar，SmartDV FPGA設(shè)計總監(jiān)本系列文章從數(shù)字芯片設(shè)計項目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計和驗證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述了在FPGA上使用硅知識產(chǎn)權(quán)（IP）內(nèi)核來開發(fā)ASIC原型項目時，必須認(rèn)真考慮的一些問題。全文從介紹使用... （來源：新聞頻道）

FPGA數(shù)字芯片設(shè)計 2024-10-28 15:45

數(shù)字芯片設(shè)計驗證經(jīng)驗分享系列文章（第四部分）：將ASIC IP核移植到FPGA上——如何測試IP核的功能和考慮純電路以外的其他因素

作者：Philipp Jacobsohn，SmartDV首席應(yīng)用工程師Sunil Kumar，SmartDV FPGA設(shè)計總監(jiān)本系列文章從數(shù)字芯片設(shè)計項目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計和驗證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述了在FPGA上使用IP核來開發(fā)ASIC原型項目時，必須認(rèn)真考慮的一些問題。文章從介紹使用預(yù)先定制功能即I... （來源：技術(shù)文章頻道）

數(shù)字芯片設(shè)計驗證經(jīng)驗 ASIC IP FPGA 2024-8-30 10:35

將ASIC IP核移植到FPGA上——如何確保性能與時序以完成充滿挑戰(zhàn)的任務(wù)！

數(shù)字芯片設(shè)計驗證經(jīng)驗分享（第三部分）：將ASIC IP核移植到FPGA上——如何確保性能與時序以完成充滿挑戰(zhàn)的任務(wù)！作者：Philipp Jacobsohn，SmartDV首席應(yīng)用工程師Sunil Kumar，SmartDV FPGA設(shè)計總監(jiān)本系列文章從數(shù)字芯片設(shè)計項目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計和驗證規(guī)劃進(jìn)行結(jié)... （來源：技術(shù)文章頻道）

數(shù)字芯片設(shè)計 ASIC IP FPGA 2024-8-26 11:52

將ASIC IP核移植到FPGA上——更新概念并推動改變以完成充滿挑戰(zhàn)的任務(wù)!

數(shù)字芯片設(shè)計驗證經(jīng)驗分享：將ASIC IP核移植到FPGA上——更新概念并推動改變以完成充滿挑戰(zhàn)的任務(wù)! 作者：Philipp Jacobsohn，SmartDV首席應(yīng)用工程師Sunil Kumar，SmartDV FPGA設(shè)計總監(jiān)本系列文章從數(shù)字芯片設(shè)計項目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計和驗證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述... （來源：技術(shù)文章頻道）

數(shù)字芯片設(shè)計ASIC IPFPGA 2024-8-1 10:20

數(shù)字芯片設(shè)計驗證經(jīng)驗分享：將ASIC IP核移植到FPGA上——明了需求和詳細(xì)規(guī)劃以完成充滿挑戰(zhàn)的任務(wù)

作者：Philipp Jacobsohn，SmartDV首席應(yīng)用工程師Sunil Kumar，SmartDV FPGA設(shè)計總監(jiān)本文從數(shù)字芯片設(shè)計項目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計和驗證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述了在FPGA上使用IP核來開發(fā)ASIC原型項目時，必須認(rèn)真考慮的一些問題。文章從介紹使用預(yù)先定制功能即IP核的必... （來源：新聞頻道）

ASIC IP核移植到FPGA數(shù)字芯片設(shè)計 2024-7-26 10:32

更深入了解汽車與航空電子等安全關(guān)鍵型應(yīng)用的IP核考量因素

作者：Philipp Jacobsohn，SmartDV高級應(yīng)用工程師中國已經(jīng)連續(xù)十多年成為全球第一大汽車產(chǎn)銷國，智能化也成為了汽車行業(yè)發(fā)展的一個重要方向，同時越來越多的制造商正在考慮進(jìn)入無人機(jī)和飛行汽車等低空設(shè)備，而所有的這些系統(tǒng)產(chǎn)品都需要先進(jìn)芯片的支撐，其中的許多芯片因其功能都是安全關(guān)鍵型芯片（safe... （來源：新聞頻道）

IP核考量因素安全標(biāo)準(zhǔn) 2024-6-20 14:45

強(qiáng)強(qiáng)聯(lián)合！Codasip與SmartDV建立伙伴關(guān)系以攜手加速芯片設(shè)計項目

外設(shè)IP的一站式購買可簡化定制RISC-V處理器設(shè)計RISC-V定制計算領(lǐng)域的領(lǐng)導(dǎo)者Codasip日前宣布，其已選擇SmartDV Technologies作為其外設(shè)設(shè)計硅知識產(chǎn)權(quán)（IP）的首選提供商。Codasip的客戶現(xiàn)在可以根據(jù)同一授權(quán)協(xié)議和合同去購買一系列精選的SmartDV外設(shè)IP的授權(quán)。這一合作伙伴關(guān)系支持使用Codasip RISC-V處... （來源：新聞頻道）

Codasip SmartDV 芯片設(shè)計項目 2023-6-28 09:17

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數(shù)字芯片設(shè)計驗證經(jīng)驗分享系列文章（第四部分）：將ASIC IP核移植到FPGA上——如何測試IP核的功能和考慮純電路以外的其他因素

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將ASIC IP核移植到FPGA上——更新概念并推動改變以完成充滿挑戰(zhàn)的任務(wù)!

數(shù)字芯片設(shè)計驗證經(jīng)驗分享：將ASIC IP核移植到FPGA上——明了需求和詳細(xì)規(guī)劃以完成充滿挑戰(zhàn)的任務(wù)

更深入了解汽車與航空電子等安全關(guān)鍵型應(yīng)用的IP核考量因素

強(qiáng)強(qiáng)聯(lián)合！Codasip與SmartDV建立伙伴關(guān)系以攜手加速芯片設(shè)計項目